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据了解,该芯片采用了软件定义与三维近存计算相结合的技术路线。一方面,通过软件定义芯片技术,硬件资源可以根据不同任务动态调配,大幅提升算力利用率;另一方面,通过三维垂直堆叠技术,将计算单元与存储单元紧密集成在一起,访存带宽达到每秒6.4TB,从架构上缓解了长期困扰芯片设计的“存储墙”瓶颈。
由于不再单纯依赖制程微缩来提升性能,这条技术路线的供应链更加稳定可控。同步发布的还有与该芯片配套的全栈软件工具链,兼容主流深度学习框架,并形成了从单张加速卡、AI服务器,到液冷超节点、大规模智算集群的完整产品体系,能够为大模型训练与推理提供规模化、可落地的算力支撑。
业内认为,这标志着我国在高端算力芯片领域,探索出了一条以架构创新代替制程追随的自主发展新路,对夯实人工智能算力底座具有重要意义。
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